0 引言
傳統數據采集卡多采用PCI或ISA總線接口，這種方式安裝麻煩、價格昂貴，且受計算機插槽數量、地址、中斷資源限制，有擴展性差等缺點。而USB通用串行總線則具有安裝方便、高帶寬、易擴展等優點，其中USB2.0標準具有480Mbps的最高數據傳輸率，這使USB成為本系統所選接口的主要類型。控制方面，傳統數據采集通常使用單片機或DSP作CPU來進行控制和數據處理。其中單片機的時鐘頻率低，無法適應高速數據采集；DSP雖能滿足速度要求，但在速度提高的同時，也提高了成本。而用FPGA實現的SOPC則具有時鐘頻率高、內部延時小和配置靈活等優勢。數據顯示方面，采用虛擬儀器不但可按要求設計且變換靈活，還能執行傳統儀器無法實現的許多功能。為此，本系統使用FPGA實現SOPC數據采集系統，并利用Labview實現系統的顯示與控制。
1數據采集系統總體設計
基于SOPC的高速數據采集系統總體框圖如圖1所示。圖中差模電感器，ADC(Analog t0 Digital Converter)模數轉換器采用的是8位高速模數轉換器TLV5580。調理電路用于實現對輸入信號的限幅、限壓、濾波，并用增加輸入阻抗的措施來獲取預期有效信號，同時保護后端AD轉換芯片。FPGA采用ALTERA公司的EPIC6Q240芯片來實現ADC控制及FIFO數據緩存；基于FPGA芯片的控制系統可直接用邏輯實現，也可在其基礎上實現SOPC對數據的采集、電感生產廠家傳輸的控制。USB采用CYPRESS公司可支持USB2.0協議的高速芯片CY7C68013。FPGA可控制TLV5580的連續采樣，并將數據送到FIFO數據緩存。當采集到一定量的數據后，CY7C68013便采用slave fifo方式將數據送給PC端，并由PC端軟件Labview實現的虛擬儀器進行顯示和控制等處理。
2數據采集系統硬件設計
2.1 模數轉換器TLV5580及其控制
TLV5580是一款高速8位模擬／數字轉換器，它具有80 Msps采樣速率，是一款3.3 V工作電壓的低功耗6級流水線結構高速A／D芯片。它的采樣信號每1個時鐘周期可通過一個STAGE，完成連續轉換到數據輸出共需6個時鐘周期。此流水線結構由6個ADC／DAC級和一個終極快閃ADC構成。采用A／D-D／A兩次變化以及糾錯邏輯的目的在于進行差錯校正，以保證流水線上各個階段在滿操作溫度范圍下，ADC的偏移量能夠得到補償且不丟失代碼。TLV5580的時序圖如圖2所示?？梢钥闯?，該A／D轉換器時序簡單，容易控制。當輸出使能(OE)為低電平時，一旦數據流水線滿，其數據將在每一個時鐘周期的上升沿輸出。
2.2 US共模電感器B芯片CY7C68013(FX2)
為了滿足對USB傳輸速度較高的需要，本設計選擇了Cypress公司內置USB接口的微控制器芯片EZUSBFX2。FX2系列芯片獨特的結構使其數據傳輸速度最高可達56Mbps，故可最大限度地滿足USB2.0的帶寬。此外，CY7C68013提供有一個串行接口引擎(SIE)，可負責大
插件電感器部分USB2.0協議的處理工作，從而大大減輕USB協議處理的工作量，并可提供4KB的FIFO，以保證數據高速傳輸的需要。CY7C68013可配置成三種不同的接口模式：Ports、GPIF Master和Slave FIFO。本項目采用Slave FIFO模式。在該模式下，外部邏輯或外部處理器直接連接到FX2的端點FIFO，因為外部邏輯可以直接控制FIFO，所以，FIFO的基本控制信號(標志、片選、使能)均由FX2的引腳引出。其外部控制可以是同步，也可以是異步，可以使用內部時鐘，也可以使用外部時鐘。
2.3 FPGA器件EPIC60240C6
FPGA (Field Programmable Gate Array)即現場可編一體成型電感程門陣列。本設計選用的是ALTERA公司的EPIC60240芯片，該芯片的工作電壓為1.5 V，存儲器密度可達5980個邏輯單元，它包含20個128x36位RAM塊，總的RAM空間達92160位，此外還內嵌了2個鎖相環電路和一個用于連接SDRAM的特定雙數據率接口，故可支持多種不同的I／O標準。事實上，這里的FPGA除了可以直接編程以進行邏輯控制外，也可在此基礎上構建SOPC系統，以便使用軟、硬件協同方法，與SDRAM構成一個大容量的FIFO來對SDRAM以及MD轉換器進行控制，同時完成與USB器件的協同工作。
2.4 SOPC及其設計
SOPC (System on a Programmable Chip)即可編程片上系統。它可以由單個芯片完成整個系統的主要邏輯功能；這種可編程系統具有靈活的設計方式，而且可裁減、可擴充、可升級。本設計采用ALTERA公司率先推出的SOPC解決方案，來將處理器、存儲、I／O口等系統所需集成到一個FPGA器件上，并對其進行軟、硬件配置，從而實現對數據的采集、傳輸、顯示控制。圖3所示是其SOPC系統框圖。
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[FPGA] 加減發嵌套我請教一下大俠，正在學習的一段程序，如下：
input iclk;? ?? ?? ?? ? //時鐘信號
input irst_n;? ?? ?? ???//復位信號
input [9:0] video_tmp;??//輸入數
找一個AC-DC電源方案（芯片）各位好，我正在找一個AC-DC電源方案（芯片），由于后面電路功耗小，1w足夠，但面積/體積要盡量小。
最好沒有變壓器（因為變壓器體積偏大）。
輸出電壓無要求，反正我后面會加DCDC芯片，但如果3.
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